/frameworks/compile/libbcc/tests/debuginfo/host-tests/ |
H A D | global_struct.c | 8 // CHECK: $1 = {d = 0.001, d2 = {10000, 100.5}} 13 double d2[2]; member in struct:double_struct 31 s.d2[0] = 1e4; 32 s.d2[1] = 100.5;
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H A D | globals.c | 20 double d2[2]; member in struct:double_struct 38 s.d2[0] = 1e4; 39 s.d2[1] = 100.5;
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/frameworks/av/media/libstagefright/codecs/on2/h264dec/omxdl/arm_neon/vc/m4p10/src_gcc/ |
H A D | armVCM4P10_TransformResidual4x4_s.S | 31 VLD4.16 {d0,d1,d2,d3},[r1] 33 VADD.I16 d5,d0,d2 34 VSUB.I16 d6,d0,d2 41 VSUB.I16 d2,d6,d7 44 VTRN.16 d2,d3 46 VADD.I16 d5,d0,d2 47 VSUB.I16 d6,d0,d2 54 VSUB.I16 d2,d6,d7 58 VRSHR.S16 d2,d2,# [all...] |
H A D | omxVCM4P10_TransformDequantLumaDCFromPair_s.S | 32 VLD4.16 {d0,d1,d2,d3},[r0] 38 VADD.I16 d5,d2,d3 41 VSUB.I16 d7,d2,d3 45 VSUB.I16 d2,d6,d7 49 VTRN.16 d2,d3 52 VADD.I16 d5,d2,d3 54 VSUB.I16 d7,d2,d3 57 VSUB.I16 d2,d6,d7 66 VMLAL.S16 q5,d2,d5 70 VSHRN.I32 d2,q [all...] |
H A D | armVCM4P10_InterpolateLuma_HalfDiagHorVer4x4_unsafe_s.S | 35 VEXT.8 d2,d0,d1,#2 39 VADDL.U8 q1,d2,d3 43 VMLA.I16 d10,d2,d31 46 VEXT.8 d2,d0,d1,#2 50 VADDL.U8 q1,d2,d3 55 VMLA.I16 d12,d2,d31 58 VEXT.8 d2,d0,d1,#2 62 VADDL.U8 q1,d2,d3 67 VMLA.I16 d14,d2,d31 70 VEXT.8 d2,d [all...] |
H A D | omxVCM4P10_PredictIntra_16x16_s.S | 85 VLD1.8 {d2[],d3[]},[r0],r4 88 VST1.8 {d2,d3},[r3],r5 90 VLD1.8 {d2[],d3[]},[r0],r4 92 VST1.8 {d2,d3},[r3],r5 94 VLD1.8 {d2[],d3[]},[r0],r4 96 VST1.8 {d2,d3},[r3],r5 98 VLD1.8 {d2[],d3[]},[r0],r4 100 VST1.8 {d2,d3},[r3],r5 112 VLD1.8 {d2[0]},[r0],r10 113 VLD1.8 {d2[ [all...] |
H A D | omxVCM4P10_DequantTransformResidualFromPairAndAdd_s.S | 61 VLD1.16 {d0,d1,d2,d3},[r4] 69 VMUL.I16 d2,d2,d8 73 VTRN.16 d2,d3 76 VADD.I16 d5,d0,d2 77 VSUB.I16 d6,d0,d2 84 VSUB.I16 d2,d6,d7 87 VTRN.16 d2,d3 89 VADD.I16 d5,d0,d2 90 VSUB.I16 d6,d0,d2 [all...] |
H A D | omxVCM4P10_PredictIntraChroma_8x8_s.S | 67 VPADDL.U8 d2,d0 68 VPADDL.U16 d3,d2 69 VPADDL.U8 d2,d1 70 VPADDL.U16 d1,d2 71 VADD.I32 d2,d3,d1 72 VRSHR.U32 d2,d2,#3 80 VTBL.8 d0,{d2-d3},d5 81 VTBL.8 d4,{d1-d2},d6 97 VPADDL.U8 d2,d [all...] |
H A D | omxVCM4P10_PredictIntra_4x4_s.S | 52 VLD1.8 {d2[]},[r0] 58 VST1.32 {d2[0]},[r3] 123 VDUP.8 d2,d3[7] 124 VEXT.8 d4,d3,d2,#1 125 VEXT.8 d5,d3,d2,#2 129 VDUP.8 d2,d0[7] 130 VEXT.8 d3,d0,d2,#4 131 VEXT.8 d4,d0,d2,#5 132 VEXT.8 d5,d0,d2,#6 173 VLD1.8 {d2[ [all...] |
H A D | omxVCM4P10_InterpolateLuma_s.S | 117 VRHADD.U8 d2,d2,d10 122 VST1.32 {d2[0]},[r2] 134 VRHADD.U8 d24,d24,d2 153 VRHADD.U8 d2,d2,d16 158 VST1.32 {d2[0]},[r2] 171 VRHADD.U8 d24,d24,d2 186 VST1.32 {d2[0]},[r2] 204 VRHADD.U8 d2,d [all...] |
H A D | armVCM4P10_InterpolateLuma_HalfVer4x4_unsafe_s.S | 49 VMLS.I16 d2,d16,d30 61 VADD.I16 d2,d2,d21 65 VQRSHRUN.S16 d2,q1,#5
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H A D | omxVCM4P10_FilterDeblockingLuma_VerEdge_I_s.S | 36 VLD1.8 {d2[]},[r3] 80 VCGT.U8 d19,d2,d19 81 VCGT.U8 d12,d2,d12 83 VCGT.U8 d17,d2,d17 116 VLD1.8 {d2[]},[r8] 124 VLD1.8 {d2[]},[r8] 155 VLD1.8 {d2[]},[r8] 163 VLD1.8 {d2[]},[r3]
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H A D | omxVCM4P10_FilterDeblockingChroma_HorEdge_I_s.S | 35 VLD1.8 {d2[]},[r3]! 64 VCGT.U8 d12,d2,d12 65 VCGT.U8 d19,d2,d19 68 VCGT.U8 d17,d2,d17 92 VLD1.8 {d2[]},[r3]
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H A D | omxVCM4P10_FilterDeblockingLuma_HorEdge_I_s.S | 36 VLD1.8 {d2[]},[r3] 66 VCGT.U8 d19,d2,d19 67 VCGT.U8 d12,d2,d12 69 VCGT.U8 d17,d2,d17 113 VLD1.8 {d2[]},[r8]
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H A D | armVCM4P10_Interpolate_Chroma_s.S | 67 VLD1.8 {d2},[r0],r10 70 VMULL.U8 q3,d2,d12 77 VMLAL.U8 q2,d2,d14 106 VLD1.8 {d2},[r0],r10 108 VMULL.U8 q3,d2,d12 113 VMLAL.U8 q2,d2,d14 129 VLD1.8 {d2},[r0],r10 131 VMULL.U8 q3,d2,d12 136 VMLAL.U8 q2,d2,d14
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H A D | armVCM4P10_DeblockingChroma_unsafe_s.S | 43 VLD1.8 {d2[]},[r3] 59 VLD1.8 {d2[]},[r3]
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/frameworks/rs/cpu_ref/ |
H A D | rsCpuIntrinsics_neon_ColorMatrix.S | 81 vld4.8 {d0[0],d1[0],d2[0],d3[0]}, [r1]! 82 vld4.8 {d0[1],d1[1],d2[1],d3[1]}, [r1]! 83 vld4.8 {d0[2],d1[2],d2[2],d3[2]}, [r1]! 84 vld4.8 {d0[3],d1[3],d2[3],d3[3]}, [r1]! 88 vld4.8 {d0[0],d1[0],d2[0],d3[0]}, [r1]! 89 vld4.8 {d0[1],d1[1],d2[1],d3[1]}, [r1]! 90 vld4.8 {d0[2],d1[2],d2[2],d3[2]}, [r1]! 91 vld4.8 {d0[3],d1[3],d2[3],d3[3]}, [r1]! 100 veor d2, d2 [all...] |
H A D | rsCpuIntrinsics_neon_3DLUT.S | 140 2: vld4.u8 {d0,d2,d4,d6}, [r1]! 148 vmovl.u8 q1, d2 168 vmovn.u16 d2, q1 171 /* q0,d2,q2 fractional offset 189 lanepair dst=d12, src=d12, xr0=d0[0], xr1=d0[1], yr0=d2[0], yr1=d2[1], zr0=d4[0], zr1=d4[1] 192 lanepair dst=d13, src=d13, xr0=d0[2], xr1=d0[3], yr0=d2[2], yr1=d2[3], zr0=d4[2], zr1=d4[3] 195 lanepair dst=d14, src=d14, xr0=d1[0], xr1=d1[1], yr0=d2[4], yr1=d2[ [all...] |
H A D | rsCpuIntrinsics_neon_Convolve.S | 77 vmlal.s16 q8, d14, d2[0] 87 vmlal.s16 q9, d15, d2[0] 132 vld1.16 {d0, d1, d2, d3}, [r6]! 173 vmlal.s16 q4, d27, d2[0] 174 vmlal.s16 q4, d28, d2[1] 185 vmlal.s16 q5, d28, d2[0] 186 vmlal.s16 q5, d29, d2[1] 210 vmlal.s16 q4, d18, d2[2] 211 vmlal.s16 q4, d19, d2[3] 222 vmlal.s16 q5, d19, d2[ [all...] |
/frameworks/av/media/libstagefright/codecs/m4v_h263/dec/src/ |
H A D | post_filter.cpp | 189 int mbnum, strength, A_D, d1_2, d1, d2, A, B, C, D, b_size; local 259 d2 = -(-A_D >> 2); 260 if (d2 < -d1_2) 262 d2 = -d1_2; 267 d2 = A_D >> 2; 268 if (d2 > d1_2) 270 d2 = d1_2; 274 *(rec_y - width2) = A - d2; 281 *(rec_y + width) = D + d2; 356 d2 [all...] |
/frameworks/av/media/libstagefright/codecs/on2/h264dec/omxdl/reference/vc/m4p10/src/ |
H A D | armVCM4P10_FwdTransformResidual4x4.c | 57 int d2 = pSrc[i+2]; local 61 int e2 = d1 + d2; 62 int e3 = d1 - d2;
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H A D | armVCM4P10_TransformResidual4x4.c | 58 int d2 = pSrc[i+2]; local 60 int e0 = d0 + d2; 61 int e1 = d0 - d2;
|
/frameworks/base/libs/common_time/ |
H A D | common_clock.cpp | 136 uint32_t d2 = 1000000; local 139 LinearTransform::reduce(&n1, &d2); 141 LinearTransform::reduce(&n2, &d2); 146 cur_trans_.a_to_b_denom = d1 * d2;
|
/frameworks/av/media/libstagefright/codecs/on2/h264dec/source/ |
H A D | h264bsd_transform.c | 100 i32 d1, d2, d3; local 121 d2 = data[14]; 124 data[14] = (d2 * tmp2); 128 d2 = data[5]; 131 data[2] = (d2 * tmp1); 135 d2 = data[3]; 138 data[8] = (d2 * tmp1); 141 d2 = data[12]; 144 data[7] = (d2 * tmp3); 149 d2 [all...] |
/frameworks/av/media/libstagefright/codecs/aacenc/src/asm/ARMV7/ |
H A D | R4R8First_v7.s | 41 VLD1.I32 {d0, d1, d2, d3}, [r0]! 46 VSUB.S32 d7, d2, d3 @ r2 = buf[4] - buf[6]@i2 = buf[5] - buf[7]@ 47 VADD.S32 d6, d2, d3 @ r3 = buf[4] + buf[6]@i3 = buf[5] + buf[7]@ 80 VADD.S32 d14, d2, d10 81 VSUB.S32 d18, d2, d10 132 VLD1.I32 {d0, d1, d2, d3}, [r0] 136 VSUB.S32 d7, d2, d3 @ r4 = buf[4] + buf[6]@ r5 = buf[5] + buf[7]@ 137 VADD.S32 d6, d2, d3 @ r6 = buf[4] - buf[6]@ r7 = buf[5] - buf[7]@
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