[go: nahoru, domu]

JPH10178014A - Method for manufacturing semiconductor device - Google Patents

Method for manufacturing semiconductor device

Info

Publication number
JPH10178014A
JPH10178014A JP33667096A JP33667096A JPH10178014A JP H10178014 A JPH10178014 A JP H10178014A JP 33667096 A JP33667096 A JP 33667096A JP 33667096 A JP33667096 A JP 33667096A JP H10178014 A JPH10178014 A JP H10178014A
Authority
JP
Japan
Prior art keywords
etching
gas
dry etching
metal film
connection hole
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP33667096A
Other languages
Japanese (ja)
Other versions
JP2891952B2 (en
Inventor
Masaru Kasai
西 優 葛
Toshiyasu Onoda
利 康 小野田
Joji Fukuda
田 丈 二 福
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shibaura Mechatronics Corp
Original Assignee
Shibaura Engineering Works Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shibaura Engineering Works Co Ltd filed Critical Shibaura Engineering Works Co Ltd
Priority to JP8336670A priority Critical patent/JP2891952B2/en
Publication of JPH10178014A publication Critical patent/JPH10178014A/en
Application granted granted Critical
Publication of JP2891952B2 publication Critical patent/JP2891952B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Electrodes Of Semiconductors (AREA)
  • Drying Of Semiconductors (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

PROBLEM TO BE SOLVED: To avoid a reduction in throughput in manufacturing a semiconductor device by chemical dry etching, and also remove substantially all residues of a metal film while taking care of excessively digging the metal film of an electrode connection hole. SOLUTION: A tungsten film 14 in a region other than an electrode connection hole 11 is removed by chemical dry etching. This step for chemical dry etching comprises a first etching in which an etching speed is relatively high; and a second etching in which an etching speed after this first etching is relatively low. The first etching uses a first reactive gas of a mixture of a gas containing fluoric atoms, a gas containing chlorine atoms and an oxygen gas, and the second etching uses a second reactive gas of a mixture of a gas containing fluoric atoms and an oxygen gas and is carried out at lower power than the first dry etching. In this second reactive gas, a ratio of a gas containing fluoric atoms to an oxygen gas is 1:(1.5 to 1.0).

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、半導体装置の製造
方法に係り、特に半導体基板の層間絶縁膜に穿孔された
電極用の接続孔にタングステンなどの金属膜を埋設する
半導体装置の製造方法に関する。
The present invention relates to a method of manufacturing a semiconductor device, and more particularly to a method of manufacturing a semiconductor device in which a metal film such as tungsten is buried in a connection hole for an electrode formed in an interlayer insulating film of a semiconductor substrate. .

【0002】[0002]

【従来の技術】半導体装置は、集積度の向上に伴い回路
線幅が益々微細化している。このため、電極コンタクト
・ホール、すなわち電極接続孔も小径化し、配線層の充
分なカバレイジを得るためにタングステンが電極接続孔
に埋設される。このタングステンの埋設は一般に以下の
ように行われる。すなわち、半導体基板の層間絶縁膜に
電極接続孔をドライエッチングによって形成して、その
後にバリアメタル膜としてチタン膜及びチタン化合物膜
をスパッタリングで成膜し、更にCVD法によって半導
体基板の全面にタングステン膜を成膜して電極接続孔に
タングステン膜を埋込み、その後に電極接続孔以外の領
域のタングステン膜をエッチングによって除去する。
2. Description of the Related Art In semiconductor devices, circuit line widths have become increasingly finer as the degree of integration increases. For this reason, the diameter of the electrode contact hole, that is, the electrode connection hole is also reduced, and tungsten is buried in the electrode connection hole in order to obtain sufficient coverage of the wiring layer. The burying of tungsten is generally performed as follows. That is, an electrode connection hole is formed in an interlayer insulating film of a semiconductor substrate by dry etching, then a titanium film and a titanium compound film are formed as a barrier metal film by sputtering, and a tungsten film is formed on the entire surface of the semiconductor substrate by a CVD method. Is formed and a tungsten film is buried in the electrode connection hole, and thereafter, the tungsten film in a region other than the electrode connection hole is removed by etching.

【0003】このようなバリアメタル膜上のタングステ
ンの除去は、バリアメタル膜上にタングステン残渣が残
存しないように行う必要があり、このためにオーバーエ
ッチングが行われている。
[0003] Such removal of tungsten on the barrier metal film needs to be performed so that no tungsten residue remains on the barrier metal film, and for this reason, over-etching is performed.

【0004】[0004]

【発明が解決しようとする課題】ところが、上述した従
来の半導体装置の製造方法は、オーバーエッチングによ
ってタングステン残渣を全て除去しようとすると、しば
しば電極接続孔のタングステン膜を掘り過ぎてしまうと
いった問題がある。これを詳述すると、一般にタングス
テン膜のエッチングは、半導体装置の生産のスループッ
トを高めるために出来るだけ高速で行われる。この高速
エッチングによってタングステン残渣を全て除去するよ
うにオーバーエッチングを行うと、電極接続孔のタング
ステン膜を掘り過ぎてしまう。
However, the above-described conventional method for manufacturing a semiconductor device has a problem that the tungsten film in the electrode connection hole is often excessively dug when attempting to remove all the tungsten residue by over-etching. . More specifically, in general, the etching of the tungsten film is performed at as high a speed as possible in order to increase the throughput of semiconductor device production. If overetching is performed so as to remove all of the tungsten residue by this high-speed etching, the tungsten film in the electrode connection hole will be dug too much.

【0005】なお、特開平7−221178号公報は、
反応性イオンエッチング処理において、最初にフッ素系
のガスと酸素ガスとの混合ガスを用いてタングステン膜
について第1のエッチングを行い、その後に、フッ素系
のガスと窒素ガスとの混合ガスを用いてタングステン残
渣を除去するオーバーエッチングを行う半導体装置の製
造方法を開示している。このようにエッチング処理を2
段階に別けて行うことによって、電極接続孔のタングス
テン膜を掘り過ぎないようにしながらタングステン残渣
を全て除去する。
[0005] Japanese Patent Application Laid-Open No. 7-221178 discloses that
In the reactive ion etching process, first, a tungsten film is first etched using a mixed gas of a fluorine-based gas and an oxygen gas, and thereafter, a mixed gas of a fluorine-based gas and a nitrogen gas is used. A method of manufacturing a semiconductor device that performs over-etching for removing a tungsten residue is disclosed. In this way, the etching process
By performing the steps separately, all the tungsten residues are removed while preventing the tungsten film in the electrode connection holes from being dug too much.

【0006】しかしながら、上述した特開平7−221
178号公報は、反応性イオンエッチング処理によって
タングステン残渣を除去することができる半導体装置の
製造方法を開示するものであって、ケミカルドライエッ
チング処理によってタングステン残渣を除去する方法に
ついてはなんら開示していない。
However, the above-mentioned Japanese Patent Application Laid-Open No. 7-221
No. 178 discloses a method of manufacturing a semiconductor device capable of removing a tungsten residue by a reactive ion etching process, but does not disclose a method of removing a tungsten residue by a chemical dry etching process. .

【0007】そこで、本発明の目的は、ケミカルドライ
エッチングによって、半導体装置の製造のスループット
の低下を避けると共に電極接続孔の金属膜を掘り過ぎな
いようにしながら金属膜の残渣を実質的に全て除去する
ことができる半導体装置の製造方法を提供することであ
る。
SUMMARY OF THE INVENTION An object of the present invention is to provide a chemical dry etching method that avoids a decrease in the throughput of the manufacture of a semiconductor device and removes substantially all residues of a metal film while preventing the metal film in an electrode connection hole from being dug. To provide a method for manufacturing a semiconductor device.

【0008】[0008]

【課題を解決するための手段】この目的を達成するため
に請求項1に記載された発明は、半導体基板の層間絶縁
膜に電極用の接続孔を穿孔する工程と、上記電極用の接
続孔と上記層間絶縁膜との上にバリヤメタル膜を形成す
る工程と、上記電極用の接続孔を埋めるように上記電極
用の接続孔及び上記バリヤメタル膜の上に金属膜を形成
する工程と、ケミカルドライエッチングによって上記電
極用の接続孔以外の領域の上記金属膜を除去する工程と
を具備する半導体装置の製造方法において、上記ケミカ
ルドライエッチング工程は、フッ素原子を含むガスと塩
素原子を含むガスと酸素ガスとを混合した第1の反応性
ガスを用いた第1のドライエッチングと、上記第1のド
ライエッチングの後に行われ、フッ素原子を含むガスと
酸素ガスとを混合した第2の反応性ガスを用いた第2の
ドライエッチングとを含み、上記第2のドライエッチン
グは上記第1のドライエッチングよりも低いパワーで行
われ、上記第2の反応性ガスは上記フッ素原子を含むガ
スと上記酸素ガスとの比が1:(1.5〜10)である
ことを特徴とするものである。
In order to achieve the above object, according to the first aspect of the present invention, there is provided a process for forming a connection hole for an electrode in an interlayer insulating film of a semiconductor substrate, and a method for forming the connection hole for an electrode. Forming a metal film on the connection hole for the electrode and the barrier metal film so as to fill the connection hole for the electrode, and forming the metal film on the barrier metal film. Removing the metal film in a region other than the connection hole for the electrode by etching, wherein the chemical dry etching step comprises the steps of: A first dry etching using a first reactive gas mixed with a gas, and a first dry etching using the first reactive gas mixed with a gas containing a fluorine atom and an oxygen gas. A second dry etching using a second reactive gas, wherein the second dry etching is performed at a lower power than the first dry etching, and the second reactive gas is The ratio between the gas containing atoms and the oxygen gas is 1: (1.5 to 10).

【0009】第1のエッチングはフッ素原子を含むガス
と塩素原子を含むガスと酸素ガスとを混合した第1の反
応性ガスを用いて比較的高速度で行われ、従って、比較
的短時間でバリヤメタル膜上の金属膜のエッチング除去
が行われる。第2のエッチングはフッ素原子を含むガス
と酸素ガスとを混合した第2の反応性ガスを用いて行わ
れ、第1のエッチングよりも低いパワーであるため、比
較的低速度のエッチングによって第1のエッチングの際
に残存した金属膜残渣を除去する。
The first etching is performed at a relatively high speed by using a first reactive gas obtained by mixing a gas containing a fluorine atom, a gas containing a chlorine atom, and an oxygen gas. The metal film on the barrier metal film is removed by etching. The second etching is performed using a second reactive gas in which a gas containing a fluorine atom and an oxygen gas are mixed, and has lower power than the first etching. The metal film residue remaining during the etching is removed.

【0010】第1のエッチングは比較的高速度であるた
め半導体装置の製造のスループットの低下を回避する。
第2のエッチングは比較的低速度であるためその終了時
点の制御を比較的容易に行うことができ、従って、電極
接続孔の金属膜を掘り過ぎないようにしながら金属膜の
残渣を実質的に全て除去することができる。請求項2に
記載された発明は、請求項1に記載の半導体装置の製造
方法において、上記フッ素原子を含むガスはCFとC
とCとNFとSFとから選択されたい
ずれかであり、上記塩素原子を含むガスはClである
ことを特徴とするものである。
Since the first etching is performed at a relatively high speed, it is possible to avoid a decrease in the throughput of manufacturing the semiconductor device.
Since the second etching is performed at a relatively low speed, it is relatively easy to control the end point of the second etching. Therefore, the residue of the metal film is substantially eliminated while the metal film in the electrode connection hole is not excessively dug. All can be removed. According to a second aspect of the present invention, in the method of manufacturing a semiconductor device according to the first aspect, the gas containing fluorine atoms is CF 4 and C 4.
Is any one selected from 2 F 6 and C 3 F 8 and NF 3 and SF 6 Prefecture, is characterized in that gas containing the chlorine atom is Cl 2.

【0011】フッ素原子を含むガスとしては、種々の組
成のガスを使用することができるが、CFとC
とCとNFとSFが好ましい。請求項3に記
載された発明は、請求項2に記載の半導体装置の製造方
法において、上記第1及び第2のドライエッチングは放
電分離型のマイクロ波励起プラズマ方式ドライエッチン
グであり、上記第2のドライエッチングのマイクロ波パ
ワーは上記第1のドライエッチングのマイクロ波パワー
の約1/2以下であることを特徴とするものである。
As the gas containing a fluorine atom, gases having various compositions can be used, and CF 4 and C 2 F 6 can be used.
And C 3 F 8 , NF 3 and SF 6 are preferred. According to a third aspect of the present invention, in the method of manufacturing a semiconductor device according to the second aspect, the first and second dry etchings are discharge-separated microwave-excited plasma type dry etching, The microwave power of the first dry etching is not more than about 1/2 of the microwave power of the first dry etching.

【0012】第2のドライエッチングのマイクロ波パワ
ーを第1のドライエッチングのマイクロ波パワーの約1
/2以下に選定することによって、第2のドライエッチ
ングは第1のドライエッチングに比べて充分に低速にす
ることができる。請求項4に記載された発明は、請求項
2に記載の半導体装置の製造方法において、上記ケミカ
ルドライエッチング工程は、上記金属膜を上記バリヤメ
タル膜に対して選択比が100以上で選択的にエッチン
グすることを特徴とするものである。
The microwave power of the second dry etching is reduced to about 1 of the microwave power of the first dry etching.
By setting the ratio to / 2 or less, the second dry etching can be performed at a sufficiently low speed as compared with the first dry etching. According to a fourth aspect of the present invention, in the method of manufacturing a semiconductor device according to the second aspect, in the chemical dry etching step, the metal film is selectively etched at a selectivity of 100 or more with respect to the barrier metal film. It is characterized by doing.

【0013】第1の反応性ガス及び第2の反応性ガスの
使用によって、金属膜をバリヤメタル膜に対して選択比
が100以上で選択的にエッチングすることができる。
請求項5に記載された発明は、請求項4に記載の半導体
装置の製造方法において、上記第1及び第2のドライエ
ッチングは約40℃以下の温度で行われることを特徴と
するものである。上述の選択比を100以上とするため
には、温度を約40℃以下に選定することが望ましい。
By using the first reactive gas and the second reactive gas, the metal film can be selectively etched at a selectivity of 100 or more with respect to the barrier metal film.
According to a fifth aspect of the present invention, in the method of manufacturing a semiconductor device according to the fourth aspect, the first and second dry etchings are performed at a temperature of about 40 ° C. or less. . In order to make the above-mentioned selectivity 100 or more, it is desirable to select the temperature to be about 40 ° C. or less.

【0014】[0014]

【発明の実施の形態】以下に本発明による半導体装置の
製造方法の実施例を図1乃至図4を参照して説明する。
図1は、本発明による半導体装置の製造方法の第1の実
施例を実施するために適した放電分離型のマイクロ波励
起ドライエッチング装置を示したものである。真空容器
1のエッチング室2内には、被処理物Wを載置する載置
台3が設置されている。この載置台3は温度調節機構を
有し、載置された被処理物Wの加熱温度を制御可能であ
る。真空容器1の上壁にはガス導入管4が連通し、この
ガス導入管4には放電管5が接続されている。この放電
管5にはそのガス導入口6から反応性ガスが導入され
る。放電管5にはマイクロ波導波管7が接続され、この
マイクロ波導波管7は放電管5にマイクロ波を印加し
て、放電管5内にプラズマを発生させる。また、真空容
器1の下壁には排気管8が接続されている。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of a method for manufacturing a semiconductor device according to the present invention will be described below with reference to FIGS.
FIG. 1 shows a discharge separation type microwave-excited dry etching apparatus suitable for carrying out a first embodiment of a method of manufacturing a semiconductor device according to the present invention. In the etching chamber 2 of the vacuum vessel 1, a mounting table 3 on which the workpiece W is mounted is installed. The mounting table 3 has a temperature control mechanism, and can control the heating temperature of the mounted workpiece W. A gas introduction tube 4 communicates with the upper wall of the vacuum vessel 1, and a discharge tube 5 is connected to the gas introduction tube 4. Reactive gas is introduced into the discharge tube 5 from the gas inlet 6. A microwave waveguide 7 is connected to the discharge tube 5. The microwave waveguide 7 applies a microwave to the discharge tube 5 to generate plasma in the discharge tube 5. An exhaust pipe 8 is connected to a lower wall of the vacuum vessel 1.

【0015】次に、載置台3に載置された被処理物Wの
構造について説明する。被処理物Wは、図2に示したよ
うにシリコン基板9と、この上に積層されたシリコン酸
化膜からなる層間絶縁膜10と、この層間絶縁膜10に
穿孔された電極接続孔11と、この電極接続孔11内及
び層間絶縁膜10の表面に形成されたバリヤメタル膜と
して機能するチタン膜12及び窒化チタン膜13と、電
極接続孔11を埋めるようにシリコン基板9の全面に積
層されたタングステン膜14とから構成される。なお、
このタングステン膜14はタングステン合金膜やその他
の金属膜を使用することもできる。
Next, the structure of the workpiece W mounted on the mounting table 3 will be described. As shown in FIG. 2, the workpiece W includes a silicon substrate 9, an interlayer insulating film 10 made of a silicon oxide film stacked thereon, an electrode connection hole 11 formed in the interlayer insulating film 10, A titanium film 12 and a titanium nitride film 13 functioning as barrier metal films formed in the electrode connection holes 11 and on the surface of the interlayer insulating film 10, and tungsten laminated on the entire surface of the silicon substrate 9 so as to fill the electrode connection holes 11. And a film 14. In addition,
As the tungsten film 14, a tungsten alloy film or another metal film can be used.

【0016】なお、電極接続孔11は、層間絶縁膜10
にレジストを塗布しそれをパターニングした後に、ドラ
イエッチングを行うことによって穿孔される。また、チ
タン膜12及び窒化チタン膜13はスパッタリングによ
って成膜され、タングステン膜14はCVD(化学気相
成長)法によって成膜される。
The electrode connection hole 11 is formed in the interlayer insulating film 10
After a resist is applied and patterned, dry etching is performed to make holes. The titanium film 12 and the titanium nitride film 13 are formed by sputtering, and the tungsten film 14 is formed by a CVD (chemical vapor deposition) method.

【0017】図2に示した構成の被処理物Wが図1の載
置台3に載置されると、第1のエッチング処理が行われ
る。この第1のエッチング処理では、被処理物Wは載置
台3に内蔵された温度調節機構によって約25℃に加熱
され、エッチング室2の圧力は30Paに選定され、マ
イクロ波パワーは700Wに選定されている。この状態
で、CFガスとClガスとOガスとを混合した第
1の反応性ガスがガス導入口6から放電管5に導入され
ると共に、700Wパワーのマイクロ波がマイクロ波導
波管7から放電管5に印加されてプラズマを発生させ
る。放電管5に導入された第1の反応性ガスは、プラズ
マによって活性化されてエッチング室2に流入し、載置
台3に載置された被処理物Wのタングステン膜14をエ
ッチングして、排気管8から排出される。
When the workpiece W having the structure shown in FIG. 2 is mounted on the mounting table 3 shown in FIG. 1, a first etching process is performed. In the first etching process, the workpiece W is heated to about 25 ° C. by the temperature control mechanism built in the mounting table 3, the pressure in the etching chamber 2 is set to 30 Pa, and the microwave power is set to 700 W. ing. In this state, the first reactive gas obtained by mixing the CF 4 gas, the Cl 2 gas, and the O 2 gas is introduced into the discharge tube 5 from the gas inlet 6, and the microwave of 700 W power is applied to the microwave waveguide. 7 is applied to the discharge tube 5 to generate plasma. The first reactive gas introduced into the discharge tube 5 is activated by the plasma, flows into the etching chamber 2, etches the tungsten film 14 of the workpiece W mounted on the mounting table 3, and exhausts the gas. It is discharged from the pipe 8.

【0018】この第1のエッチング処理は比較的高速度
で被処理物Wのタングステン膜14をエッチングし、こ
れによって図3に示したように電極接続孔12以外の領
域のタングステン膜14は僅かなタングステン残渣15
を残して全て除去される。被処理物Wは、上述の第1の
エッチング処理を受けた後に、第2のエッチング処理を
受ける。この第2のエッチング処理では、被処理物Wの
加熱温度及びエッチング室2の圧力が第1のエッチング
処理の場合と同一の約25℃及び30Paに夫々選定さ
れ、マイクロ波パワーが第1のエッチング処理の場合の
1/2以下の300Wに選定されている。この状態で、
CFガスとOガスとを混合した第2の反応性ガスが
ガス導入口6から放電管5に導入されると共に、300
Wパワーのマイクロ波がマイクロ波導波管7から放電管
5に印加されてプラズマを発生させる。放電管5に導入
された第2の反応性ガスは、プラズマによって活性化さ
れてエッチング室2に流入し、載置台3に載置された被
処理物Wのタングステン膜の残渣15をエッチングし
て、排気管8から排出される。なお、第2の反応性ガス
は、CFガスとOガスとの比が1:(1.5〜1
0)に選定されている。この範囲に選定した理由はエッ
チング速度を低速に抑えることが主目的である。全反応
性ガスに対する酸素ガスの比率を50%以上にした方が
エッチング速度を低く抑えられるからである。
In the first etching process, the tungsten film 14 of the workpiece W is etched at a relatively high speed. As a result, as shown in FIG. Tungsten residue 15
Are removed except for The workpiece W undergoes the second etching process after the first etching process. In the second etching process, the heating temperature of the workpiece W and the pressure in the etching chamber 2 are selected to be approximately 25 ° C. and 30 Pa, respectively, which are the same as those in the first etching process, and the microwave power is set to the first etching process. It is selected to be 300 W which is less than half of the case of processing. In this state,
A second reactive gas in which a CF 4 gas and an O 2 gas are mixed is introduced into the discharge tube 5 from the gas inlet 6 and 300
A microwave of W power is applied from the microwave waveguide 7 to the discharge tube 5 to generate plasma. The second reactive gas introduced into the discharge tube 5 is activated by the plasma, flows into the etching chamber 2, and etches the tungsten film residue 15 of the workpiece W placed on the mounting table 3. Are discharged from the exhaust pipe 8. The ratio of the CF 4 gas to the O 2 gas is 1: (1.5 to 1).
0). The main purpose of selecting this range is to keep the etching rate low. This is because the etching rate can be reduced by setting the ratio of the oxygen gas to all the reactive gases to 50% or more.

【0019】この第2のエッチング処理は、第1のエッ
チング処理に比べて除去すべきタングステン膜、即ちタ
ングステン残渣15が極めて少ないため、第1のエッチ
ング処理に比べてマイクロ波パワーを充分に低減するこ
とができ、エッチング処理速度を充分に下げることがで
きる。従って、電極接続孔11に埋設されたタングステ
ン膜14を殆ど掘り下げることなく、窒化チタン膜13
上のタングステン膜14をほぼ完全に除去することがで
きる。
In the second etching process, since the amount of the tungsten film to be removed, that is, the tungsten residue 15 to be removed is extremely small as compared with the first etching process, the microwave power is sufficiently reduced as compared with the first etching process. And the etching rate can be sufficiently reduced. Therefore, the titanium nitride film 13 is hardly digged in the tungsten film 14 buried in the electrode connection hole 11.
The upper tungsten film 14 can be almost completely removed.

【0020】このように、第1のエッチングと第2のエ
ッチングとの組み合わせによって、全体のエッチング時
間の増大を引き起こすことなく、電極接続孔11に埋設
されたタングステン膜14の掘れ量dを極めて小さくな
るように制御することができる。また、被処理物Wの加
熱温度を25℃に選定したので、タングステン膜14を
窒化チタン膜13に対して選択比が100以上でエッチ
ングすることができる。
As described above, by the combination of the first etching and the second etching, the digging amount d of the tungsten film 14 buried in the electrode connection hole 11 can be made extremely small without increasing the overall etching time. Can be controlled so that Further, since the heating temperature of the workpiece W is set to 25 ° C., the tungsten film 14 can be etched with a selectivity of 100 or more with respect to the titanium nitride film 13.

【0021】図4は上述の第1及び第2のエッチング処
理におけるエッチング時間とタングステン膜のエッチン
グ量(厚さ)との関係を示したもので、直線Aは第1の
エッチング処理の場合の関係を表し、直線Bは第1のエ
ッチング処理の場合の関係を表し、ハッチングした領域
はタングステン残渣が残り易い範囲を表している。直線
Aと直線Bとを比較すると分かるように、第1のエッチ
ング処理のエッチング速度は第2のエッチング処理のエ
ッチング速度よりも非常に大きい。従って、第1のエッ
チング処理を、僅かにタングステン残渣が残る程度で、
例えば図4のT付近で終了し、その後に第2のエッチン
グ処理を行うと、全体のエッチング時間をできるだけ短
縮しながら、図3のタングステン膜14の掘れ量dを極
めて小さく抑えることができる。特に、第2のエッチン
グ処理は比較的低速度で行われるため、その終了時点を
高精度に制御することができる。
FIG. 4 shows the relationship between the etching time and the etching amount (thickness) of the tungsten film in the above-described first and second etching processes. The straight line A indicates the relationship in the case of the first etching process. And a straight line B represents a relationship in the case of the first etching process, and a hatched region represents a range where a tungsten residue is likely to remain. As can be seen by comparing the straight lines A and B, the etching rate of the first etching process is much higher than the etching speed of the second etching process. Therefore, the first etching process is performed with only a slight tungsten residue remaining.
For example, if the process is completed near T in FIG. 4 and then the second etching process is performed, the digging amount d of the tungsten film 14 in FIG. 3 can be extremely reduced while shortening the entire etching time as much as possible. In particular, since the second etching process is performed at a relatively low speed, the end point can be controlled with high accuracy.

【0022】上述の実施例では、第1及び第2の反応性
ガスはフッ素原子を含むガスとしてCFガスを使用し
たが、しかしながら、CFガスの他に、CとC
とNFとSFなどを使用することもできる。
また、塩素原子を含むガスもCl以外のガスを使用す
ることもできる。また、タングステン膜14を窒化チタ
ン膜13に対して選択比100以上でエッチングするた
めには、上述の実施例では被処理物Wの加熱温度を25
℃としたが、約40℃以下の温度であれば、同様の効果
を得ることができる。
In the above-described embodiment, CF 4 gas was used as the first and second reactive gases as a gas containing fluorine atoms. However, in addition to CF 4 gas, C 2 F 6 and C 2
Etc. 3 F 8 and NF 3 and SF 6 can be used.
Further, a gas other than Cl 2 can also be used as the gas containing a chlorine atom. Further, in order to etch the tungsten film 14 with respect to the titanium nitride film 13 at a selectivity of 100 or more, in the above-described embodiment, the heating temperature of the workpiece W is set to 25 degrees.
C., but the same effect can be obtained if the temperature is about 40 ° C. or less.

【0023】更に、実施例は放電分離型のマイクロ波励
起プラズマ方式ケミカルドライエッチング方法を使用し
たが、自己バイアス効果の少ないECRやICP等のド
ライエッチング方法も使用することができる。
Further, in the embodiment, a discharge-separated type microwave-excited plasma type chemical dry etching method is used, but a dry etching method such as ECR or ICP having a small self-bias effect can also be used.

【0024】[0024]

【発明の効果】以上の説明から明らかなように本発明に
よれば、第1のエッチングは比較的高速度であるため半
導体装置の製造のスループットの低下を回避することが
できると共に、第2のエッチングは比較的低速度である
ためその終了時点の制御を比較的容易に行うことがで
き、従って、電極接続孔の金属膜を掘り過ぎないように
しながら金属膜の残渣を実質的に全て除去することがで
きる。
As is apparent from the above description, according to the present invention, since the first etching is performed at a relatively high speed, it is possible to avoid a decrease in the throughput of manufacturing a semiconductor device. Since the etching is performed at a relatively low speed, the end point can be controlled relatively easily. Therefore, substantially all of the residue of the metal film is removed while preventing the metal film in the electrode connection hole from being dug. be able to.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明による半導体装置の製造方法の実施例に
使用される放電分離型のマイクロ波励起プラズマ方式ケ
ミカルドライエッチング装置を示した概略図。
FIG. 1 is a schematic view showing a discharge-separated microwave-excited plasma type chemical dry etching apparatus used in an embodiment of a method of manufacturing a semiconductor device according to the present invention.

【図2】タングステン膜のエッチング前の被処理物を示
した断面図。
FIG. 2 is a cross-sectional view showing an object to be processed before etching a tungsten film.

【図3】タングステン膜の残渣が残った被処理物を示し
た断面図。
FIG. 3 is a cross-sectional view illustrating a processing object in which a residue of a tungsten film remains.

【図4】第1及び第2のエッチング処理についてエッチ
ング時間とエッチング量との関係を示したグラフ。
FIG. 4 is a graph showing a relationship between an etching time and an etching amount for first and second etching processes.

【符号の説明】[Explanation of symbols]

9 半導体基板 10 層間絶縁膜 11 電極接続孔 12 、13 バリアメタル膜 12 チタン膜 13 窒化チタン膜 14 金属膜(タングステン膜) Reference Signs List 9 semiconductor substrate 10 interlayer insulating film 11 electrode connection hole 12, 13 barrier metal film 12 titanium film 13 titanium nitride film 14 metal film (tungsten film)

Claims (5)

【特許請求の範囲】[Claims] 【請求項1】半導体基板の層間絶縁膜に電極用の接続孔
を穿孔する工程と、上記電極用の接続孔と上記層間絶縁
膜との上にバリヤメタル膜を形成する工程と、上記電極
用の接続孔を埋めるように上記電極用の接続孔及び上記
バリヤメタル膜の上に金属膜を形成する工程と、ケミカ
ルドライエッチングによって上記電極用の接続孔以外の
領域の上記金属膜を除去する工程とを具備する半導体装
置の製造方法において、上記ケミカルドライエッチング
工程は、フッ素原子を含むガスと塩素原子を含むガスと
酸素ガスとを混合した第1の反応性ガスを用いた第1の
ドライエッチングと、上記第1のドライエッチングの後
に行われ、フッ素原子を含むガスと酸素ガスとを混合し
た第2の反応性ガスを用いた第2のドライエッチングと
を含み、上記第2のドライエッチングは上記第1のドラ
イエッチングよりも低いパワーで行われ、上記第2の反
応性ガスは上記フッ素原子を含むガスと上記酸素ガスと
の比が1:(1.5〜10)であることを特徴とする半
導体装置の製造方法。
A step of forming a connection hole for an electrode in an interlayer insulating film of a semiconductor substrate; a step of forming a barrier metal film on the connection hole for the electrode and the interlayer insulating film; Forming a metal film on the connection hole for the electrode and the barrier metal film so as to fill the connection hole, and removing the metal film in a region other than the connection hole for the electrode by chemical dry etching. In the method for manufacturing a semiconductor device provided, the chemical dry etching step includes a first dry etching using a first reactive gas obtained by mixing a gas containing a fluorine atom, a gas containing a chlorine atom, and an oxygen gas; A second dry etching using a second reactive gas obtained by mixing a gas containing a fluorine atom and an oxygen gas, which is performed after the first dry etching; The dry etching is performed at a lower power than the first dry etching, and the ratio of the fluorine-containing gas to the oxygen gas in the second reactive gas is 1: (1.5 to 10). A method for manufacturing a semiconductor device, comprising:
【請求項2】上記フッ素原子を含むガスはCFとC
とCとNFとSFとから選択されたいず
れかであり、上記塩素原子を含むガスはClであるこ
とを特徴とする請求項2に記載の半導体装置の製造方
法。
2. The gas containing a fluorine atom comprises CF 4 and C 2
3. The method according to claim 2 , wherein the gas containing chlorine atoms is one selected from F 6 , C 3 F 8 , NF 3, and SF 6, and the gas containing chlorine atoms is Cl 2. 4. .
【請求項3】上記第1及び第2のドライエッチングは放
電分離型のマイクロ波励起プラズマ方式ドライエッチン
グであり、上記第2のドライエッチングのマイクロ波パ
ワーは上記第1のドライエッチングのマイクロ波パワー
の約1/2以下であることを特徴とする請求項2に記載
の半導体装置の製造方法。
3. The first and second dry etchings are discharge-separated microwave-excited plasma type dry etching, and the microwave power of the second dry etching is the microwave power of the first dry etching. 3. The method of manufacturing a semiconductor device according to claim 2, wherein the ratio is about 1/2 or less.
【請求項4】上記ケミカルドライエッチング工程は、上
記金属膜を上記バリヤメタル膜に対して選択比が100
以上で選択的にエッチングすることを特徴とする請求項
2に記載の半導体装置の製造方法。
4. The method according to claim 1, wherein the chemical dry etching step is performed such that the selectivity of the metal film to the barrier metal film is 100.
3. The method according to claim 2, wherein the etching is performed selectively.
【請求項5】上記第1及び第2のドライエッチングは約
40℃以下の温度で行われることを特徴とする請求項4
に記載の半導体装置の製造方法。
5. The method according to claim 4, wherein said first and second dry etchings are performed at a temperature of about 40 ° C. or less.
13. The method for manufacturing a semiconductor device according to item 5.
JP8336670A 1996-12-17 1996-12-17 Method for manufacturing semiconductor device Expired - Fee Related JP2891952B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP8336670A JP2891952B2 (en) 1996-12-17 1996-12-17 Method for manufacturing semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP8336670A JP2891952B2 (en) 1996-12-17 1996-12-17 Method for manufacturing semiconductor device

Publications (2)

Publication Number Publication Date
JPH10178014A true JPH10178014A (en) 1998-06-30
JP2891952B2 JP2891952B2 (en) 1999-05-17

Family

ID=18301591

Family Applications (1)

Application Number Title Priority Date Filing Date
JP8336670A Expired - Fee Related JP2891952B2 (en) 1996-12-17 1996-12-17 Method for manufacturing semiconductor device

Country Status (1)

Country Link
JP (1) JP2891952B2 (en)

Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011035366A (en) * 2009-08-04 2011-02-17 Novellus Systems Inc Method of depositing tungsten on feature with high aspect ratio
US9034768B2 (en) 2010-07-09 2015-05-19 Novellus Systems, Inc. Depositing tungsten into high aspect ratio features
US9082826B2 (en) 2013-05-24 2015-07-14 Lam Research Corporation Methods and apparatuses for void-free tungsten fill in three-dimensional semiconductor features
US9177781B2 (en) 2010-07-09 2015-11-03 Tokyo Electron Limited Plasma processing method and manufacturing method of semiconductor device
US9240347B2 (en) 2012-03-27 2016-01-19 Novellus Systems, Inc. Tungsten feature fill
US9548228B2 (en) 2009-08-04 2017-01-17 Lam Research Corporation Void free tungsten fill in different sized features
US9589835B2 (en) 2008-12-10 2017-03-07 Novellus Systems, Inc. Method for forming tungsten film having low resistivity, low roughness and high reflectivity
US9972504B2 (en) 2015-08-07 2018-05-15 Lam Research Corporation Atomic layer etching of tungsten for enhanced tungsten deposition fill
US9978610B2 (en) 2015-08-21 2018-05-22 Lam Research Corporation Pulsing RF power in etch process to enhance tungsten gapfill performance
US10256142B2 (en) 2009-08-04 2019-04-09 Novellus Systems, Inc. Tungsten feature fill with nucleation inhibition
US10566211B2 (en) 2016-08-30 2020-02-18 Lam Research Corporation Continuous and pulsed RF plasma for etching metals

Cited By (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9589835B2 (en) 2008-12-10 2017-03-07 Novellus Systems, Inc. Method for forming tungsten film having low resistivity, low roughness and high reflectivity
US10256142B2 (en) 2009-08-04 2019-04-09 Novellus Systems, Inc. Tungsten feature fill with nucleation inhibition
TWI495756B (en) * 2009-08-04 2015-08-11 Novellus Systems Inc Depositing tungsten into high aspect ratio features
US9653353B2 (en) 2009-08-04 2017-05-16 Novellus Systems, Inc. Tungsten feature fill
US9548228B2 (en) 2009-08-04 2017-01-17 Lam Research Corporation Void free tungsten fill in different sized features
JP2011035366A (en) * 2009-08-04 2011-02-17 Novellus Systems Inc Method of depositing tungsten on feature with high aspect ratio
US10103058B2 (en) 2009-08-04 2018-10-16 Novellus Systems, Inc. Tungsten feature fill
US9034768B2 (en) 2010-07-09 2015-05-19 Novellus Systems, Inc. Depositing tungsten into high aspect ratio features
US9177781B2 (en) 2010-07-09 2015-11-03 Tokyo Electron Limited Plasma processing method and manufacturing method of semiconductor device
US9240347B2 (en) 2012-03-27 2016-01-19 Novellus Systems, Inc. Tungsten feature fill
US9082826B2 (en) 2013-05-24 2015-07-14 Lam Research Corporation Methods and apparatuses for void-free tungsten fill in three-dimensional semiconductor features
US9972504B2 (en) 2015-08-07 2018-05-15 Lam Research Corporation Atomic layer etching of tungsten for enhanced tungsten deposition fill
US11069535B2 (en) 2015-08-07 2021-07-20 Lam Research Corporation Atomic layer etch of tungsten for enhanced tungsten deposition fill
US9978610B2 (en) 2015-08-21 2018-05-22 Lam Research Corporation Pulsing RF power in etch process to enhance tungsten gapfill performance
US10395944B2 (en) 2015-08-21 2019-08-27 Lam Research Corporation Pulsing RF power in etch process to enhance tungsten gapfill performance
US10566211B2 (en) 2016-08-30 2020-02-18 Lam Research Corporation Continuous and pulsed RF plasma for etching metals

Also Published As

Publication number Publication date
JP2891952B2 (en) 1999-05-17

Similar Documents

Publication Publication Date Title
JP4579611B2 (en) Dry etching method
US7368394B2 (en) Etch methods to form anisotropic features for high aspect ratio applications
US20070202700A1 (en) Etch methods to form anisotropic features for high aspect ratio applications
JP3897372B2 (en) Etching method of metal film
JP2891952B2 (en) Method for manufacturing semiconductor device
JP3318801B2 (en) Dry etching method
JP2991177B2 (en) Method for manufacturing semiconductor device
US6756314B2 (en) Method for etching a hard mask layer and a metal layer
US6740598B2 (en) Wiring layer dry etching method and semiconductor device manufacturing method
US20040038547A1 (en) Method of etching a metal layer using a mask, a metallization method for a semiconductor device, a method of etching a metal layer, and an etching gas
US6057230A (en) Dry etching procedure and recipe for patterning of thin film copper layers
JP2727966B2 (en) Method for manufacturing semiconductor device
JPH10189537A (en) Dry etching method
JP2000164571A (en) Method for forming contact hole and plasma etching method
JPH1197428A (en) Method for dry etching metal wiring
JP3238563B2 (en) Method for manufacturing semiconductor device
JP2001077193A (en) Formation of contact
JPH10177997A (en) Instant etching process of barc and nitride
JPH1050660A (en) Etching silicon nitride film
JP3440599B2 (en) Via hole formation method
JPH11330045A (en) Method for etching laminated film of oxide film and silicon layer
JPH0982686A (en) Plasma processing system and manufacture of semiconductor device
JPH07263406A (en) Method of manufacturing semiconductor device
JPH08339987A (en) Wiring forming method
JP2002246393A (en) Method of forming metal wiring

Legal Events

Date Code Title Description
FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080226

Year of fee payment: 9

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 10

Free format text: PAYMENT UNTIL: 20090226

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090226

Year of fee payment: 10

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100226

Year of fee payment: 11

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100226

Year of fee payment: 11

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 12

Free format text: PAYMENT UNTIL: 20110226

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120226

Year of fee payment: 13

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120226

Year of fee payment: 13

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130226

Year of fee payment: 14

LAPS Cancellation because of no payment of annual fees